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- 硬件電路:旁路電容/去耦電容的區(qū)別分析
- 本文作者是一位女工程師,作為一名偏軟件的嵌入式工程師,在硬件領域會碰到各種orz問題,此文為其工作中真是遇到的經驗記錄,希望對我們也有所啟發(fā)。
最近工作重心由軟件
- 2018-11-29 關注:172
- CPLD初學者入門知識總結
- CPLD按英語說是復雜可編程邏輯器件,對于一個硬件工程師來說,能應用cpld技術是一個十分強大的能力。它的應用可在根本上解決許多數(shù)字電路設計的問題,能大幅度改變設計思想
- 2018-11-29 關注:178
- 設置異步時鐘的問題解答
- 問題:2個頻率無關的時鐘,在sel的選擇下做切換。
有時一個看起來簡單,實際上是在考驗ASIC工程師的問題。
1.簡單的講就是做信號的2選1么,那么我們就先做一個簡答的
- 2018-11-28 關注:188
- 儀表放大器的常見問題分析
- 儀表放大器被廣泛地應用在現(xiàn)實世界中的資料截取。然而,設計工程師在使用它們時,卻經常會出現(xiàn)不當使用的情形。具體來說,盡管現(xiàn)代儀表放大器具有優(yōu)異的共模抑制CMR,但設計
- 2018-11-24 關注:546
- AD6.9的測試
- 很多工程師將完成的PCB圖直接交由制板廠制作,但是有時候制板廠轉換出來的gerber文件不是我們想要的。例如我們用的AD作出的圖,但是有的廠只用protel,那轉換出來的帶有漢字
- 2018-11-24 關注:167
- 串聯(lián)諧振特點分析
- 串聯(lián)諧振特點:電路呈純電阻性,端電壓和總電流同相,此時阻抗最小,電流最大,在電感和電容上可能產生比電源電壓大很多倍的高電壓,因此串聯(lián)諧振也稱電壓諧振。在電力工程
- 2018-11-24 關注:164
- 如何切斷2個頻率無關的時鐘?
- 問題:2個頻率無關的時鐘,在sel的選擇下做切換。
有時一個看起來簡單,實際上是在考驗ASIC工程師的問題。
1.簡單的講就是做信號的2選1么,那么我們就先做一個簡答的
- 2018-11-24 關注:180